IMPEDANZKONTROLLIERTE LEITERPLATTEN
Controlled-Impedance-PCB mit Stackup-Review, Coupon und TDR-Prüfung
Impedanzkontrollierte Leiterplatten fertigen mit Stackup-Review, TDR-Coupon, ±10% oder ±5% Toleranz und DFM-Prüfung für High-Speed-PCB anfragen.
Kurz gefasst
- Impedanzkontrollierte Leiterplatten brauchen vor CAM-Freigabe Zielimpedanz, Toleranz, Stackup und relevante Netznamen.
- WellPCB prüft Microstrip, Stripline, Dielektrikum, Kupferdicke, Lötstopp und Coupon-Logik gemeinsam.
- Typische Zielwerte sind 50 Ohm Single-Ended sowie 90 oder 100 Ohm differentiell.
- TDR-Coupons und ±10% oder ±5% Toleranz werden je Los nach Material- und Prozessfreigabe geplant.
Impedanzkontrollierte Leiterplatten sind PCBs, deren Leiterbahngeometrie, Dielektrikum, Kupferdicke und Referenzebenen so gefertigt werden, dass schnelle Signale eine definierte charakteristische Impedanz sehen. Eine Microstrip-Leitung ist eine Signalleitung auf einer Aussenlage mit Referenzebene darunter; eine Stripline liegt zwischen zwei Referenzebenen und reduziert Abstrahlung, benötigt aber engere Stackup-Kontrolle. Ein TDR-Coupon ist eine Teststruktur auf dem Fertigungsnutzen, die den Ziel-Leiterbahnaufbau nachbildet und per Time Domain Reflectometry vermessen wird. WellPCB nutzt impedanzkontrollierte Fertigung für USB, Ethernet, LVDS, MIPI, DDR, RF-nahe Industrieelektronik, Antennenmodule und BGA-nahe Multilayer. Der Unterschied zu einer allgemeinen Multilayer-PCB-Seite liegt im RFQ-Ziel: Diese Seite behandelt nicht nur Lagenzahl und Material, sondern die messbare Freigabe von 50-Ohm-, 75-Ohm-, 90-Ohm- und 100-Ohm-Signalpfaden.
Leistungsmerkmale
Real Project Snapshot
Ein Robotics-OEM aus der Asia-Pacific region organisierte ein PCB- und Assembly-Programm als multi-PO program mit split PIs. Für solche High-Speed-Baugruppen ist Impedanzkontrolle nicht nur ein Layoutthema, sondern Teil der Liefer- und Freigabelogik.
Das Projekt zeigte, warum technische Freigabe und kommerzielle Terminsteuerung zusammengehören: same-day payment confirmation und early delivery warning issued hielten den Ablauf transparent, während die kritischen Daten für die betroffenen Leiterplatten sauber nachgeführt wurden.
Die konkrete Lehre für impedanzkontrollierte Leiterplatten: Zielimpedanz, Stackup, Netznamen, Toleranz, Coupon und Messbericht müssen vor der Split-Lieferung geklärt sein. Sonst entsteht Streit nicht erst bei der Signalqualität, sondern schon bei Abnahme und Lieferplan.
Warum WellPCB für Impedanzkontrollierte Leiterplatten?
WellPCB ist für impedanzkontrollierte Leiterplatten sinnvoll, wenn Ihr Team eine messbare Fertigungsfreigabe statt einer reinen Rechnerannahme braucht. Wir prüfen Gerber oder ODB++, Stackup, Zielimpedanzen, Netznamen, Toleranzen, Materialfamilie, Kupferdicke, Lötstopp, Oberfläche und Testcoupon gemeinsam. Das wichtigste Spannungsfeld ist Kosten gegen Messsicherheit: ±10% ist für viele Industrie-, USB- und Ethernet-Designs ausreichend, während ±5% ein engeres Material- und Prozessfenster verlangt. Jeder zusätzliche Impedanzwert kann einen eigenen Coupon, mehr Nutzfläche und zusätzliche Messzeit erzeugen. Für RFQs empfehlen wir deshalb, Zielwerte zu konsolidieren, zum Beispiel 50 Ohm Single-Ended und 100 Ohm differentiell, statt unnötig viele Varianten zu spezifizieren. Hommer Zhao und das Engineering-Team bewerten solche Projekte aus Lieferantensicht: Wenn ein Stackup auf Papier funktioniert, aber die verfügbare Prepreg-Kombination, Kupferzunahme oder Lötstoppdicke nicht passt, korrigieren wir vor CAM-Freigabe und nicht nach einem fehlerhaften TDR-Bericht.
Unser Prozess
Der Prozess startet mit Gerber oder ODB++, Bohrdaten, Zielimpedanzliste, Netznamen, Toleranzfenster, gewünschtem Frequenzbereich, Materialpräferenz und Zielmenge. Zuerst prüfen wir, ob die Impedanznetze wirklich einer Referenzebene folgen, ob Rückstrompfade unterbrochen sind und ob Via-Stubs, Lagenwechsel oder Steckverbinderzonen die Messlogik beeinflussen. Danach schlagen wir einen fertigungsgerechten Stackup vor: Kern- und Prepreg-Dicken, Kupferbasis, erwartete Endkupferdicke, Lötstoppannahme und Zielbreiten je Microstrip oder Stripline. Nach Freigabe legen wir den Impedanzcoupon auf den Fertigungsnutzen, fertigen die Leiterplatten mit Innenlagen-AOI, Lamination, Bohren, Durchkontaktierung, Aussenlagenstruktur, Finish und 100% E-Test. Bei vereinbartem Messumfang wird der Coupon per TDR geprüft und als Messbericht dem Los zugeordnet. Nicht im Scope sind Wunderkorrekturen ohne Netznamen, nachträgliche Impedanzgarantien auf bereits freigegebenen Standard-Stackups oder HF-Systemvalidierung auf Geräteebene; dafür braucht es kundenseitige Signal-Integrity- und Labormessungen.
Relevante Standards und Referenzen
Characteristic impedance erklärt die physikalische Grundlage der charakteristischen Impedanz, die für 50-Ohm- und 100-Ohm-Leitungen relevant ist.
Streifenleitung ordnet Microstrip, Stripline und koplanare Leitungen als typische PCB-Übertragungsleitungen ein.
IPC in der Elektronik gibt öffentlichen Kontext zu IPC-A-600, IPC-6012 und IPC-A-610 als Referenzen für Leiterplatten und Baugruppen.
Produktgalerie
Anwendungsbereiche
Unser Qualitätsversprechen
Bei WellPCB setzen wir auf kompromisslose Qualität. Unsere Fertigung erfolgt strikt nach IPC-Standards. Durch unser durchgängiges ERP-System gewährleisten wir volle Rückverfolgbarkeit (Traceability) bis auf Bauteilebene.
Häufige Fragen
Welche Daten braucht WellPCB für impedanzkontrollierte Leiterplatten?
Wir benötigen Gerber oder ODB++, Bohrdaten, Zielimpedanzen, Netznamen, Toleranzfenster, gewünschten Stackup, Materialvorgaben und Zielmenge. Für 50 Ohm, 90 Ohm oder 100 Ohm differenziell müssen die betroffenen Netze eindeutig markiert sein. Ohne Netznamen kann ein Hersteller zwar Geometrien schätzen, aber keinen belastbaren TDR-Coupon und keine saubere Messfreigabe planen.
Ich brauche 100 Ohm differential für USB 3.x; reicht ein Standard-FR4-Stackup?
100 Ohm differentiell ist auf FR4 oft machbar, wenn Referenzebene, Leiterbahnbreite, Paarabstand, Kupferdicke und Dielektrikum zusammenpassen. Kritisch wird es bei enger Packungsdichte, vielen Lagenwechseln, langen Stubs oder sehr engem ±5%-Fenster. WellPCB prüft zuerst, ob ein Standard-FR4- oder High-Tg-FR4-Aufbau reicht; bei Verlustbudget oder Frequenzgrenze empfehlen wir Low-Loss- oder Rogers-Optionen.
Was ist der Unterschied zwischen berechneter und gemessener Impedanz?
Berechnete Impedanz basiert auf Stackup-Annahmen wie Dk, Dielektrikumsdicke, Leiterbahnbreite, Endkupfer und Lötstopp. Gemessene Impedanz entsteht am fertigen TDR-Coupon auf demselben Nutzen. Fertigungsrealitäten wie Ätzkompensation, Kupferzuwachs und Materialtoleranz können einige Ohm verschieben. Deshalb ist ein Coupon wichtig, wenn die Leiterplatte später nicht nur funktionieren, sondern messbar freigegeben werden muss.
Wann sollte ich ±5% statt ±10% Impedanztoleranz anfragen?
±5% ist sinnvoll, wenn Ihr Interface, Frequenzbereich oder Feldrisiko wenig Margin lässt, zum Beispiel bei schnellen seriellen Links, RF-nahen Baugruppen oder qualitätskritischen Serien. ±10% reicht für viele Industrie- und Standard-High-Speed-Designs. Das engere Fenster erhöht Aufwand, weil Materialauswahl, Coupon, Prozesskontrolle und Messung strenger geplant werden müssen.
Kann WellPCB impedanzkontrollierte Leiterplatten auch bestücken?
Ja. Impedanzkontrollierte Leiterplatten können mit SMT, BGA, THT, AOI, X-Ray, ICT/FCT und Firmware-Programmierung als PCBA geliefert werden. Bei High-Speed-Baugruppen prüfen wir die Schnittstelle zur Bestückung früh: Oberfläche, BGA-Fanout, Via-Stubs, Testpunkte, Reflow-Profil und spätere Kabel- oder Steckverbinderanbindung beeinflussen die Signalqualität.
Wie kann ich die Kosten für Controlled-Impedance-PCB senken?
Die besten Hebel sind konsolidierte Zielimpedanzen, realistische Toleranz, Standard-Prepregs, begrenzte Coupon-Anzahl, klare Netznamen und ein Stackup, der zu verfügbaren Materialien passt. Teuer wird es, wenn jedes Interface eigene Werte fordert oder die Toleranz ohne technischen Grund auf ±5% gesetzt wird. WellPCB trennt deshalb Muss-Anforderungen von Komfortspezifikationen.
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